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Les secrets du CMOS
 




 

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Sommaire :

1 - 2 - 3 - 4 - 5 - 6 - 7

 

Les Secrets de la CMOS

 

 

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Cette fonction est assuree principalement par un circuit calendrier (type 146818) pilote par un oscillateur a quartz de frequence 32,768 kHz. La capacite memoire du 146818 (64 octets) est augmentee par une memoire additionnelle (SRAM CMOS) de 8 ko sur les modeles de microordinateurs PS (IBM).

Une pile (autonomie 5 ans) assure l'alimentation de ces circuits en cas de coupure de l'alimentation generale 5 V, afin de :

  • sauvegarder les informations enregistrees dans la memoire du 146818 et dans la RAM additionnelle (heure, date, alarme et configuration).
  • conserver l'alimentation de l'oscillateur pour la fonction horloge/dateur du 146818.

Le circuit calendrier, de technologie CMOS (146818A) assure la gestion de l'heure (heures-minutes-secondes) et de la date (jours-mois-annee). Il comporte 64 registres de 8 bits :

  • les 14 premiers contiennent les informations specifiques pour la gestion de l'horloge-dateur-alarme.
  • les 50 derniers sont utilises pour sauvegarder la configuration du systeme en cas de coupure de l'alimentation generale.
    La memoire additionnelle (sur PS) est une memoire RAM statique, de technologie CMOS, de capacite 8 ko, et de 450 ns de temps d'acces. Elle consomme environ 1fA au repos. Sa fonction est d'etendre la memoire sauvegardee ; tous les registres de cette memoi re sont reserves.

 

2. Acces au 146818

L'acces a ces registres est realise en deux temps :

1-  Selection du registre desire : acces entree/sortie en ecriture a l'adresse 0070H ; le bus de donnees contient le numero du registre (de 00H a 3FH).

  • ---------------------------------------------------------
    | POINTEUR DE REGISTRE |
    ---------------------------------------------------------
    | b7 | b6 | b5 | b4 | b3 | b2 | b1 | b0 |
    ---------------------------------------------------------
    | ENMI*| X | Numero du registre |
    ---------------------------------------------------------
    ENMI* : Bit de validation du signal NMI (0=valide,1=inhibe)

     

    2 - Ecriture ou lecture de la donnee (le registre est celui pointe precedemment) : Acces entree/sortie en ecriture ou lecture a l'adresse 0071H.

    • interruption periodique (bits RS0 a RS3 du registre A, et bit PIE du registre B),
    • interruption alarme (registres 1, 3, 5 et bit AIE du registre B),
    • interruption de fin de mise a jour (bits SET et UIE du registre B).

    Une demande d'interruption de niveau IRQ8 est generee vers le controleur d'interruption, si l'interruption correspondante est armee dans le registre B.Le circuit comprend trois types d'interruption possibles :

    • interruption periodique (bits RS0 a RS3 du registre A, et bit PIE du registre B),
    • interruption alarme (registres 1, 3, 5 et bit AIE du registre B),
    • interruption de fin de mise a jour (bits SET et UIE du registre B).

    Une demande d'interruption de niveau IRQ8 est generee vers le controleur d'interruption, si l'interruption correspondante est armee dans le registre B.

             

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      Dernière mise à jour : 19/05/2017